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        高通股份有限公司專利技術

        高通股份有限公司共有37531項專利

        • 一種用于模數轉換器(ADC)的誤差校正電路,包括:第一開關;并行排列且耦合至第一開關的第二開關和校正電容器。第二開關還被耦合至接地且校正電容器還被耦合至一基準電壓,其中,第一開關被設為在ADC的保持模式期間起作用而第二開關被設為在ADC...
        • 一種時間模數轉換器(TAD)利用時間-數字方式來進行模擬-數字轉換。該TAD包括例如CMOS倒相器鏈等的兩個電壓-延遲轉換器(VDC)以增大該TAD的動態范圍。每一VDC可處理不同范圍的輸入電壓。比較器將輸入信號電壓與對應于不同范圍輸入...
        • 無線通信系統中的一種設備和方法,用于將系統比特與奇偶校驗比特交織以生成一可按多時隙分組從基站串傳送到遠程站的輸出序列。該設備包括存儲元件和耦合到該存儲元件的控制元件,其中該控制元件元被配置成將這些系統比特和奇偶校驗比特多路分解成多個序列...
        • 本發明的至少一個方面提供了一種用以實現低幀差錯率的turbo編碼器(104),其具有并行的第一和第二組成編碼器(202、206)以及作為輸入耦合至第二組成編碼器以提供輸入到第一組成編碼器的二進制數據的經置換版本的交織器(204)。該交織...
        • 在一個實施例中,本發明申請包括一種用于從高率原模圖生成低率原模圖的方法和裝置,包括:復制基圖;置換所述基圖的副本中相同類型的邊的端點以生成經置換的圖;以及修剪經置換的圖中的系統輸入節點以及連接到它們的邊。在另一個實施例中,本發明申請包括...
        • 描述了鎖相環的雙通道環路濾波器電路。相異的電荷電流允許所述濾波器部分地集成到鎖相環IC電路中,而無需使用可能造成額外噪聲并消耗額外功率的有源電路元件。減少了的濾波電容可以被集成。
        • 一種RF電壓控制振蕩(VCO)設計,該設計改善了電源的抗干擾性。尤其,VCO諧振電路能提供高電路Q值,較強的抗干擾度,以及可調諧于多個不同的波段。該諧振電路與集成電路振蕩器一起執行,該振蕩器需要一種調諧電路來確定工作頻率。當該集成電路振...
        • 在具有活動和待機模式的鎖相環頻率合成器中減少鎖定時間。在活動模式中操作頻率合成器保持穩定頻率輸出。在不需要頻率合成器提供頻率輸出的時候,待機或睡眠模式用于減少功耗。當把合成器置于等待模式時,把壓控振蕩器(VCO)調諧電壓的最近值保持在頻...
        • 一種用于合成具有最小抖動的信號的計數器。所發明的計數器具有第一計數級;連接到所述第一計數級的先行電路;以及用于在所述第一計數級的輸出和所述先行電路的輸出之間選擇所述計數器的輸出的選擇電路。在特定實施例中,第一計數級用于接收頻率為每秒N個...
        • 一種鎖相環,它結合了用于保留限定鎖相環運行模式數據的第一寄存器組(21);用于限定定義鎖相環運行模式數據的第二寄存器組(22)。開關(27至30)被用來在與第一和第二寄存器組中的一組結合,以接收限定鎖相環新運行模式的數據,而此時,第一和...
        • 通過特征化振蕩器工作環境,把振蕩器頻率誤差減少至最小限度。一種電子裝置監控可確定的對內部頻率源的頻率精度有影響的參數。溫度是已知的對內部頻率源頻率有影響的一個參數,對裝置溫度起主要作用的是RF功率放大器(PA)。此電子裝置采集和貯存PA...
        • 本公開指向用在無線通信設備中的頻率合成器。所述頻率合成器包括振蕩器,諸如壓控振蕩器(VCO)和ΣΔ受控鎖相環(PLL),所述PLL確定和控制頻率合成器的輸出頻率。ΣΔ受控PLL可以實現能降低或消除平均頻率偏移的引入的高頻抖動信號生成技術。
        • 在一個實施例中,本發明描述了一個用于無線通信設備中或用于要求頻率精確且噪聲小的類似設備中的頻率合成器。更具體而言,該頻率合成器可以包括一個鎖相環(PLL)以及一個集成壓控振蕩器(VCO)。該頻率合成器可以執行一種或多種校準技術,從而快速...
        • 本發明的實施例涉及一種鎖相環(PLL)電路。所述PLL包括以所期望頻率輸出信號的電壓控制振蕩器。相位檢測器耦合到來自所述電壓控制振蕩器的輸出。所述相位檢測器將來自電壓控制振蕩器(VCO)的信號輸出的相位與參考信號的相位進行比較。環路濾波...
        • 描述了有效處理大壓控振蕩器(VCO)增益的技術。這些技術使用(1)慢速高增益通路來提供調整VCO的中心頻率的平均控制電流和(2)快速低增益通路來提供在正常操作期間調整VCO頻率的瞬時控制電流。在一種設計中,該VCO包括電壓到電流轉換器、...
        • 在移動通信設備(例如,蜂窩電話)中,存在本機振蕩器。本機振蕩器包括一個新穎的分頻器,其包括一個新穎的可配置多模數除法器(CMMD)。該分頻器可配置為多種結構中可選擇的一種,這些結構包括同步和異步電路的不同組合。在每種結構中,分頻器產生一...
        • 本文描述一種雙路徑多模式循序存儲元件(SSE)。在一個實例中,所述雙路徑多模式SSE包括第一循序存儲元件(14)和第二循序存儲元件(12)、數據輸入端、數據輸出端和選擇器機構(16)。所述第一循序存儲元件(14)和所述第二循序存儲元件(...
        • 本發明揭示一種裝置,其包含:第一引腳,用以向集成電路的第一功率域供應功率;第二引腳,用以向所述集成電路的第二功率域供應功率;切換調節器;以及控制器。所述切換調節器耦合到所述第一引腳以向所述第一功率域提供第一經調節的功率供應,且耦合到所述...
        • 一種由p溝道與n溝道場效應晶體管(FET)構成的采樣電路。p溝道FET(42)的源節點耦合至n溝道FET(40)的漏節點,而p溝道FET(42)的漏節點耦合至n溝道FET(40)的源節點。采樣時鐘耦合至各FET的柵節點。線性采樣電路的第...
        • 一種更新和存貯計數器值的方法與設備。響應于多個N計數器更新信號的每個信號,從多個二進制存儲單元里選出某個二進制存儲單元(350),翻轉該選出的二進制存儲單元的狀態(36)。在收到N個計數器更新信號后(320),對與多個二進制存儲單元分開...
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